74LVC163是同步可预设二进制计数器，具有内部前视进位且可用于高速计数。通过在时钟（针脚CP）的正向边沿上同步所有触发器时钟提供了同步操作。计数器的输出（针脚Q0至Q3）可预设为高电平或低电平。并行使能输入（针脚PE）上的低电平可禁用计数操作并使数据输入（针脚D0至D3）上的数据加载到时钟正边沿上的计数器中（只要符合PE的设置和保持时间要求）。无论计数使能输入（针脚CEP和CET）上的电平如何都会发生预设。主复位输入（针脚MR）处的低电平会在时钟输入（针脚CP）下一次正向跃迁后将触发器的所有四个输出（针脚Q0至Q3）都置于低电平（只要符合PE的设置和保持时间要求）。无论PE、CET和CEP输入针脚上的电平如何都会发生该操作。这种同步复位特性使设计者只需一个外部与非门即可修改最大计数。

前视进位可简化计数器的串行级联。两个计数使能输入（针脚CEP和CET）都必须为高电平时才能进行计数。CET输入被前馈是为了使能终端计数输出（针脚TC）。因此而被使能的TC输出会产生一个高电平输出脉冲，其持续时间约等于Q0的高电平输出。该脉冲可用于使能下一个级联级。

级联计数器的最大时钟频率由tPHL（CP至TC的传播延迟）和tsu（CEP至CP的设置时间）确定，计算公式如下：fmax = 1/ (tPHL(max)+tsu)

• 1.2 V至3.6 V的宽电源电压范围
• 输入可接受高达5.5 V的电压
• CMOS低功耗
• 具有TTL电平的直接接口
• 同步重置
• 同步计数和加载
• 可实现n位级联的两个计数使能输入
• 正沿触发的时钟
• 符合JEDEC标准：
  • JESD8-7A（1.65 V至1.95 V）
  • JESD8-5A（2.3 V至2.7 V）
  • JESD8-C/JESD36（2.7 V至3.6 V）
• ESD保护：
  • HBM JESD22-A114F超过2000 V
  • MM JESD22-A115-B超过200 V
  • CDM JESD22-C101E超过1000 V
• 额定温度范围为-40 °C至+85 °C和-40 °C至+125 °C

• 74AXP2G3404GM - Low-power buffer and inverter
• BLS7G3135L(S)-350P - LDMOS S波段雷达功率晶体管
• PBSS304NX - 60 V、4.7 A NPN低VCEsat (BISS)晶体管
• 74HC(T)139 - 双路2至4线路解码器/解复用器
• 74LVT02D - 3.3 V四路2输入或非门
• 74AUP1G175GF - 带复位功能的低功耗D型触发器；正沿触发器
• 74AXP1G09 - 低功耗2输入与门，带开漏输出
• TEA1721FT - 适用于5 W应用、集成功率MOSFET通过高压启动的反激控制器，f~burst = 1750 Hz
• P5CD009EVD - 安全三接口、双接口和接触式PKI智能卡控制器
• BZX84J-C75 - 单倍齐纳二极管